义隆单片机EM78P458APJ，代销高速CMOS 8位单片机
| 价 格： | 2.40 |
| 品牌/商标 | 义隆 | 型号/规格 | EM78P458APJ |
| 封装 | DIP | 批号 | 10+ |
| 制作工艺 | 半导体集成 | 导电类型 | 单极型 |
| 规格尺寸 | 10（mm） | 工作温度 | -40~125（℃） |
| 类型 | 单片机 |
义隆全系列单片机定货,代销 ^#^ ^&^
EM78P458 和EM78P459 是采用高速CMOS 工艺制造的8 位单片机。其内部有4K*13 位一次性ROM（OTPROM）。因此，用户可以方便地改进完善程序。程序代码可用EMC 编程器写入芯片。 工作电压范围：2.2V~6.0V 工作温度范围：0℃~80℃ 工作频率范围：DC~16MHz 低功耗 ♦ 5V/4M 工作条件下电流小于1.5mA ♦ 3V/32K 条件下电流典型值为15μA ♦ 休眠模式下电流典型值为1μA 4K×13 位片内ROM，96×8 位片内寄存器（SDRAM） 2 个双向I/O 端口 8 级堆栈 8 位实时定时/计数器（TCC），其信号源、触发沿可编程选择，溢出产生中断 8 位多路AD 转换器，精度达13 位 2 个脉冲宽度调制器（PWM），精度达10 位 2 个比较器 掉电模式（SLEEP 模式） 六个中断源 ♦ TCC 溢出中断 ♦ 输入引脚状态变化中断（从休眠模式中唤醒） ♦ 外部中断 ♦ ADC 转换结束中断 ♦ PWM 周期匹配结束中断 ♦ 比较器输出高电平中断 可编程自由运行看门狗定时器（WDT） 有8 个I/O 引脚可编程设置为上拉 有8 个I/O 引脚可编程设置为下拉 有8 个I/O 引脚可编程设置为漏极开路 每个指令周期为两个时钟周期，99.9%的指令为单周期指令 EM78P458 为20 脚封装，EM78P459 为24 脚封装，封装形式：SOP 和DIP 具有电压检测器，检测范围2.0V
☆义隆8 bit 微控制器型号:EM78P153S、EM78P156EL\N、EM78P468N\L、EM78P154\7\9N、EM78P447SA\B\NA\B\C\D、EM78P257A\B、EM78P451S、EM78P458\9A、EM78P5840\1\2、EM78P311\12\50、EM78M611\12、EM78P809N、EM78P417\8\9N、EM78P258\59\60N、EM78P510N、EM78P860\1\2A\B\C、EM78869、EM78F651\2N等 详细的PDF资料及软件,请访问义隆网站 : http://www.emc.com.tw/
☆松翰8 bit 微控制器型号:SN8P1602B、SN8P1604、SN8P2501B、SN8P2602A、SN8P2602B,SN8P2501B,SN8P2604、SN8P2711、SN8P2714、SN8P2704、SN8P2606、SN8P2706、SN8P2608、SN8P2607、SN8P2707、501-8P,501-8S,501AP08,501AS08,SN8P2708,SN8P1907,SN8P1908,SN8P1909、SN8P2308、SN8P2612、SN8P2613、SN8P1808、SN8P1708、SN8P1707、SN8PC01、SN8P27142、SN8P27143、SN8P2705、SN8P1829,SN8P2611,SN8P2622,SN8P2624,SN8P2602,SN8P2501等.
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★★优势产品★★
1，稳压管78系列/79系列，TIP系列,78L系列,KA系列,LM系列!
2，数字电路(TTL)74HC,74LS,74HCT,74LVC,74AHCT系列
3，模拟电路(CMOS)：4000，4500系列/MOLEX 连接器
4，IR/仙童/ST/场效应管,MOS管：IRF、FDS、SI、AO系列
5，单片机及储存器系列：PIC，AT,义隆,合泰,松翰等系列
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金属膜电阻 0.125W 0.25W 0.5W 1W 2W 3W 4W 5W
信息内容：品牌/商标 国产 型号/规格 金属膜电阻0.125W 0.25W 0.5W 1W 2W 3 W 封装 DIP 批号 10+ 营销方式 现货 产品性质 热销 制作工艺 膜集成 集成程度 中规模 工作温度 -40~125（℃） 类型 其他IC
74HC165 8位并进串出移位寄存器
信息内容：品牌/商标 NXP 型号/规格 74HC165 封装 DIP/SOP 批号 11 类型 线性IC 74HC165 概述 74HC165是一款高速CMOS器件，74HC165遵循JEDEC标准no.7A。74HC165引脚兼容低功耗肖特基TTL（LSTTL）系列。 74HC165是8位并行读取或串行输入移位寄存器，可在末级得到互斥的串行输出（Q7和Q7），当并行读取（PL）输入为低时，从D0到D7口输入的并行数据将被异步地读取进寄存器内。 而当PL为高时，数据将从DS输入端串行进入寄存器，在每个时钟脉冲的上升沿向右移动一位（Q0 → Q1 → Q2，等等）。利用这种特性，只要把Q7输出绑定到下一级的DS输入，即可实现并转串扩展。 74HC165的时钟输入是一个“门控或”结构，允许其中一个输入端作为低有效时钟使能（CE）输入。CP和CE的引脚分配是独立的并且在必要时，为了布线的方便可以互换。只有在CP为高时，才允许CE由低转高。在PL上升沿来临之前，不论是CP还是CE，都应当置高，以防止数据在PL的活动状态发生位移。74HC...
